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XC6SLX25T-2CSG324C可编程逻辑器件-技术资料

作者:小编时间:2023-11-08 14:09:36 次浏览

信息摘要:

技术参数品牌:XILINX/赛灵思型号:XC6SLX25T-2CSG324C封装:原厂原封批号:22+数量:3500制造商:Xilinx产品种类:FPGA - 现场可编程门阵列RoHS:是系列:XC6SLX25T逻辑元件数量:24051 LE输入/输出端数量:190 I/O工作电源电压:1.2 V最小工作温度:0 C最大工作温度:+ 85 C安装风格:SMD/SMT封装 / 箱体:CSBGA-32

XC6SLX25T-2CSG324C.png

技术参数

品牌:XILINX/赛灵思
型号:XC6SLX25T-2CSG324C
封装:原厂原封
批号:22+
数量:3500
制造商:Xilinx
产品种类:FPGA - 现场可编程门阵列
RoHS:
系列:XC6SLX25T
逻辑元件数量:24051 LE
输入/输出端数量:190 I/O
工作电源电压:1.2 V
最小工作温度:0 C
最大工作温度:+ 85 C
安装风格:SMD/SMT
封装 / 箱体:CSBGA-324
数据速率:800 Mb/s
分布式RAM:229 kbit
内嵌式块RAM - EBR:936 kbit
最大工作频率:1080 MHz
湿度敏感性:Yes
逻辑数组块数量——LAB:1879 LAB
收发器数量:2 Transceiver
配置:Spartan-6 FPGA将cuslomized配置数据存储在SPAM类型的内部锁存器中。配置位数介于3 Mb和33 Mb之间,具体取决于设备大小和用户设计实现选项。配置存储是不稳定的,必须在FPGA通电时重新加载。也可以通过将PAOGRAM B针脚拉低,随时重新加载此存储器。有几种加载配置的方法和数据格式可用。

位串行配置可以是主串行模式,其中FPGA生成配置时钟(CCLK)信号。也可以是从串行模式,其中外部配置数据源也给FPGA时钟。对于字节范围的配置,主SelectMAP模式生成CCLK信号,而从SelectMAP模式接收8和16位范围的转发器的CCLK信号。在主串行模式下,位流的开始可以选择将时钟源切换到外部时钟,外部时钟可以比内部时钟更快或更精确。可用的JTAG引脚使用边界扫描协议来加载位串行配置数据。


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